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2 VCS debugging basics
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Verdi
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C3-06 SRAM控制器 RTL design和simulation讲解5
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5 Debugging simulation mismatches
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3 Debugging with DVE
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C6-01 AHB+APB+CPU(BFM)小系统构建
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1 VCS simulation basics
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任务17：RISC-V CPU Exception 异常处理
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7 Code coverage
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SoC 07 AMBA APB
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C4-01 Flash介绍
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SV_03_interface_program
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UVM_08_Callback
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C2-01 AMBA bus介绍
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C2-06 APB IP互联 AHB Slave的设计及验证
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任务10：RISC-V CPU Fetch 取指指令2
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01 数字电路设计Instroduction
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C7-05 芯片集成-Pinmux设计
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任务10：SD-HOST SPEC讲解
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C7-02 芯片集成-Sys_Ctrl设计 Boot启动 Subsys_Core集成
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SoC 05 AMBA2.0 AHB
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任务05：APB-SPI UVM RAL平台的自动生成讲解
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C2-05 AMBA bus介绍
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SV_01_course_overview
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任务12：RISC-V CPU执行2
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任务04：APB-SPI UVM-RAL 平台讲解2
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SoC 06 AMBA2.0 AHB02
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任务15：RISC-V CPU Commnit
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任务08：RISC-V CPU Core实例
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任务09：RISC-V CPU Fetch 取指指令1
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C6-02 sramc,sd host,flash controller集成及系统级仿真1
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任务19：RISC-V CPU Memory 2 内存系统2
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Verilog RTL编程实践 1
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MATLAB 20 小波分析工具箱
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任务03：APB-SPI UVM-RAL验证平台的搭建
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Makefile
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C2-02 AMBA bus介绍
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后端物理设计-ICC02
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SV_11_sva_sequence
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C2-04 AMBA bus介绍
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09 数字电路设计Interconnect