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基于FPGA的波形发生器设计,在EGo1开发板上验证,Vivado 2018.3,开发语言为Verilog HDL,包含DDS、DAC0832、波形控制等
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基于FPGA的波形发生器设计,在EGo1开发板上验证,开发环境为Vivado 2018.3,开发语言为Verilog HDL,包含DDS、DAC0832、波形控制等,可以通过拨码开关选择输出的波形,并通过按键调节频率输出
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