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9-特殊时序检查-多周期半周期伪路径
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课件可在www.dizhixiong.cn下载。时序收敛是数字集成电路和FPGA都极为关注的指标。本课程以经典书籍《Static Timing Analysis for Nanometer Designs: A Practical Approach》为教材,辅以时序分析笔试题。本课程受到南京ICisC及其旗下的“IC创新学院”、“南京集成电路大学”支持。本课程同时在“IC创新学院”与B站本账号播放,拒绝任何形式的转载。欢迎关注公众号“硬件加速与EDA”。
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10-特殊时序检查-多时钟
数字集成电路静态时序分析基础
2-TCL语言入门-变量列表
8-建立时间与保持时间检查
3-TCL语言入门-正则文本
5-STA基本概念
6-标准单元库
FPGA时序优化与模块稳定问题:以太网UDP协议栈时序优化与RGMII时序约束
7-STA环境-1
4-Synopsys TCL语言入门
1-课程概述
7-STA环境-2
SpinalHDL语言在典型数字电路设计中的应用
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上海交通大学微电子硕士,工作5年后的薪资情况。
11-Robust Verification
【FPGA硬件设计教程】布局布线第一期
12-Time Borrowing
【FPGA硬件设计教程】布局布线第二期(矩形放置)
FPGA 时序收敛
Cordic算法硬件FPGA实现2:知识回顾、边界问题、代码流程图
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从电路设计的角度入门VerilogHDL
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