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7-STA环境-1
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时序收敛是数字集成电路和FPGA都极为关注的指标。本课程以经典书籍《Static Timing Analysis for Nanometer Designs: A Practical Approach》为教材,重点以Synopsys TCL语言入门、工艺库、复杂时序路径分析方法为核心内容,辅以时序分析笔试题,期望同学们掌握静态时序分析方法。本课程受到南京ICisC及其旗下的“IC创新学院”、“南京集成电路大学”支持。本课程同时在“IC创新学院”与B站本账号播放,拒绝任何形式的转载。
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数字集成电路静态时序分析基础
2-TCL语言入门-变量列表
7-STA环境-2
5-STA基本概念
8-建立时间与保持时间检查
3-TCL语言入门-正则文本
6-标准单元库
1-课程概述
10-特殊时序检查-多时钟
11-Robust Verification
SpinalHDL语言入门概述
4-Synopsys TCL语言入门
兼容PIC指令集的MCU设计
集创赛2024赛题解析分享
12-Time Borrowing
SpinalHDL语言在典型数字电路设计中的应用
从电路设计的角度入门VerilogHDL
9-特殊时序检查-多周期半周期伪路径
千万不要尽信课本的 Global Routing
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